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[老师分享] PADSLogic提示： Connection can't tie into bus琀栀椀猀眀愀礀怎

TA的每日心情

	开心 2024-9-20 19:45

签到天数: 2 天

[LV.1]初来乍到

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发表于 2014-11-22 12:05:52 | 显示全部楼层 |阅读模式

元器件的端子栅格必须与原理图的相同
你的设计栅格不匹配你重新画下这个原件的封装图。让元器件的端子栅格和原理图的一样就好了。

另外画线的栅格要跟总线的栅格一至。不然容易出这个问题。

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水很深我 该用户已被删除

发表于 2014-11-23 09:10:58 | 显示全部楼层

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该用户从未签到

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发表于 2015-10-28 17:45:03 | 显示全部楼层

原理图的栅格和PCB的栅格有毛子关系？

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